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Lehrbriefe für den Fernlehrgang PC-Techniker der Fernschule Weber => Lehrbrief 10 => Thema gestartet von: cic am November 02, 2008, 20:36:35
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hey Leute bin vor kurzem auf dieses Forum getroffen. Ist echt Toll dass es dieses giebt und Euch die ihr echt gut :mrgreen: "drauf seid" :mrgreen:
leider komm ich nicht auf eine kurze Zusammenfassung der antwort, ist zu viel. könntet ihr mir vieleicht helffen...BITTE--------DANKE Leute
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Hey cic
Ok einmal so wie ich das habe.
CPLD: vergleichsweise wenige große Zellen
UND ODER Strukturen mit nachgeschalteten Flip Flops.
Schaltzeiten sind gut vorhersagbar.
FPGA: kleine Zellen in einer matrixförmigen Verbindungsstruktur angeordnet. Eine einzelne Zelle kann zb. als
Gatter, Flip Flop, oder einfache kombinatorische Schaltung konfiguriert werden. Vorhersage der
Schaltzeiten sehr schwierig.
hoffe habe dir helfen können, gab volle Punktzahl
Gruß und viel Spaß
Stricki
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Klar vielen Dank :roll: :-D :wink: des hielf sehr
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Hallo cic,
deine Frage wurde ja schon beantwortet :wink:
Aber für ein freundliches Hallo, und ein herzliches Willkommen hier im Forum, ist es nie zu spät!
Also viel Spaß hier im Forum!
Gruß Jürgen